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BugHunter Pro:一款用于 Verilog, VHDL 和 C++ 模擬器的圖形調(diào)試系統(tǒng)。BugHunter 支持所有主要的 HDL 模擬器,其主要功能包括:單一步驟調(diào)試、波形數(shù)據(jù)串流、項(xiàng)目管理等等??梢詡蓽y程序與幫助系統(tǒng)的交互過程從而發(fā)現(xiàn)問題所在。
VeriLogger Pro:Verilog模擬器軟件。提供一個(gè)綜合了傳統(tǒng)Verilog模擬器所有特征的仿真環(huán)境,它具有強(qiáng)大的圖形測試矢量產(chǎn)生器。VeriLogger的快速模型測試使用戶可以對設(shè)計(jì)中的每個(gè)模型進(jìn)行“自底向上”的測試。
WaveFormer Pro:由時(shí)序圖分析器、模擬器和測試向量生成器組合而成。它為設(shè)計(jì)人員提供了一個(gè)集成的環(huán)境,可以用來開發(fā)數(shù)字和模擬線路的時(shí)序圖。WaveFormer Pro可以由Spice模擬器,Mathematica,或Matlab等工具輸入模擬數(shù)據(jù)。還可以利用WaveFormer Pro 內(nèi)部擁有的波形函數(shù)直接生成模擬信號;或者將從總線上得到的數(shù)字信號變換成模擬信號。還可以將模擬信號波形逐段線性地變換成Spice模擬器的電壓信號源。
TestBencher Pro:用于從獨(dú)立于語言的時(shí)序邏輯表生成交互式VHDL,Verilog, OpenVera,e, 和TestBuilder 測試基準(zhǔn)及總線功能的模型。生成的測試基準(zhǔn)能提供基于仿真相應(yīng)的不同的激發(fā)向量,以便于測試基準(zhǔn)功能作為一個(gè)被測試系統(tǒng)環(huán)境的動(dòng)作模型正常工作。 TestBencher Pro是一個(gè)優(yōu)秀的測試大規(guī)模FPGA 和 ASIC設(shè)計(jì)的工具。
標(biāo)簽: 電子設(shè)計(jì)
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